二进制码与格雷码的转换(Verilog实现)

czh306 — Tue, 14 Oct 2008 06:42:00 GMT

module Bin2Grad(BinCode, GradCode);
parameter Code_Width = 8;
input [Code_Width - 1 : 0] BinCode;
output [Code_Width - 1 : 0] GradCode;

integer i;
reg [Code_Width - 1 : 0] GradCode;
always @(BinCode)
    begin
        for (i = 0; i < Code_Width - 1; i = i +1)
            begin
                GradCode[i] = BinCode[i] + BinCode[i + 1];
            end
        GradCode[Code_Width - 1] = BinCode[Code_Width - 1];
    end

endmodule

czh306 2008-10-14 14:42 发表评论

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